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Estrategias de memoria en Grantsdale
Enviado el 07/03/04 a las 02:00 por noticias

Intel

Con todas las recientes noticias sobre el chipset 925X (Alderwood), el 915P (Grantsdale) ha quedado algo olvidado. Como se indica en los planes de Intel, el i925X será exclusivamente DDR2. Por desgracia, el rendimiento inicial de la DDR2 sera, probablemente, similar a la de la DDR1 actual, y actualizarse a un chipset de gama alta no supondrá una mejora sustancial del rendimiento.

Hace algunas semanas se comentó que aunque el 915P (grantsdale) admite tanto DDR1 como DDR2, es probable que los ensambladores incluyan únicamente DDR1 en sus productos. Esto permitirá una cierta diferenciación entre el 925X y 915P.

Sin embargo, la semana pasada comenzó a llegar diferente información de distribuidores sobre la plataforma Grantsdale. Esto es lo que, probablemente, veremos:

  • Placas madre con 4 bancos de 184 pines para DDR1
  • Placas madre con 2 bancos de 184 pines para DDR1 y 2 bancos de 240 pines para DDR2

Esto significa que el 915P puede suponer un camino de actualización muy prudente. Si, por alguna razón, los productos PCI-Express de ATI o NVIDIA se vuelven más viables que sus versiones AGP, no quedará más remedio que comprar una nueva placa madre. Mantener la memoria y CPU actuales en una placa 915P permitiría a un mayor número de usuarios actualizarse en el momento del lanzamiento del nuevo bus. Unos meses después, esos mismos usuarios podrían actualizar la CPU y la memoria a DDR2 sin cambiar de placa madre. La actualización incremental nos ofrece lo mejor de ambos mundos.

Recordemos también que VIA y SIS también han prometido compatibilidad con ambos estándares en sus chipsets. Y dado que VIA se centra más en el coste que en el rendimiento, es probable que veamos más opciones 2+2 para el PT890 de VIA que para el 656 de SiS o el 915P de Intel.

¿Serán las implementaciones 2+2 de DDR1 y DDR2 más beneficiosas para los usuarios? Sin duda alguna, sí. Las mayores opciones de ampliación permiten a los usuarios comprar en función de su liquidez y tiempo.

Fuente: Anandtech (en inglés).


 
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